Artikel-ID: 000080932 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 23.09.2011

Feste Timing-Simulation der Stratix IV-SERDES_RX

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Kritisches Problem

    Beschreibung

    Ein Fehler bei der Timing-Simulation von Stratix IV-SERDES_RX wurde behoben, und in der Folge wird die Timing-Simulation von SERDES_RX nicht erfasst das Datenbit korrekt. Dieses Problem beeinflusst das Halbleiterverhalten nicht.

    Lösung

    Keine Problemumgehung.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Stratix® IV FPGAs

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