Artikel-ID: 000080663 Inhaltstyp: Produktinformationen und Dokumente Letzte Überprüfung: 03.07.2019

Wie deaktiviere ich EDID-Pass through im DisplayPort Intel® Arria® 10 FPGA IP-Designbeispiel?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • DisplayPort*
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Extended Display Identification Data (EDID) enthält Sink-Geräteinformationen (z. B. Monitor), wie die unterstützte Videoauflösung und den Timing-Standard.

    Wenn die Option Enable GPU Control (GPU-Steuerung aktivieren) im DisplayPort IP-Core-Parametereditor des DisplayPort-Intel® Arria® 10 FPGA IP-Design-Beispiels mit parallelem Sink-Source-Loopback aktiviert wird, ermöglicht der NIOS® II Prozessor den "EDID-Pass through", um das EDID vom Sink-Gerät (z. B. Monitor) zu empfangen und an das Quellgerät (z. B. Grafikprozessoreinheit).

    In Anwendungen, die nur den DisplayPort-Sink instanziieren, gibt es keine DisplayPort-Quelle in der FPGA, die das EDID vom Monitor an die GPU (Grafikprozessoreinheit) übergibt. Daher muss der EDID-Pass-Through deaktiviert werden, damit die standardmäßige EDID (altera_4k_edid) in main.c im Software-Ordner von der GPU gelesen wird.

     

     

    Lösung

    Um EDID-Pass-through zu deaktivieren, öffnen Sie die Datei config.h im Software-Ordner, ändern Sie den DP_SUPPORT_EDID_PASSTHRU Parameter in 0 und führen Sie das skript build_sw.sh aus, um die NIOS® II Software wiederherzustellen.

    Laden Sie das NIOS II® Software-Image (dp_demo.elf) im Software-/dp_demo-Ordner in den FPGA herunter.

     

    EDID PassThru vom Sink zur Quelle

    #define DP_SUPPORT_EDID_PASSTHRU 0 2. Setzen Sie auf 1, um einen EDID-Pass-Thru vom Sink zur Quelle zu ermöglichen.

    Else DP Sink verwendet standard EDID.

    Unterstützung von EDID-Pass-Thru nur, wenn sowohl Tx als auch Rx unterstützt werden

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Arria® 10 FPGAs und SoC FPGAs

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