Artikel-ID: 000079255 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 04.03.2014

* Fehler: Modulparameter "CFG_CMD_GEN_OUTPUT_REG" wurde unter alt_mem_ddrx_controller.v nicht zur Außerkraftsetzung gefunden

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • DDR3 SDRAM Controller mit UniPHY Intel® FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Möglicherweise sehen Sie den oben genannten Fehler, wenn Sie Ihren DDR3 UniPHY-Controller mit dem ModelSim-Intel® FPGA simulieren. Die Ursache des Fehlers ist die Bestellung der Kompilierungsbibliotheken im ModelSim vsim Ausarbeitungs-Aufruf.

    Lösung

    Sie müssen sicherstellen, dass die Bibliothek mit den kompilierten DDR3-Dateien zuerst im Befehl aufgeführt ist. In diesem Fall enthält das Arbeitsverzeichnis die kompilierten DDR3-Dateien:

    vsim -chipsatz -t ps -L work -L altera_ver -L lpm_ver -L sgate_ver -L altera_mf_ver -L altera_lnsim_ver -L altera_mf -L altera_lnsim -L stratixiv <top_level_filename>

    Es wird empfohlen, dass Sie der Datei- und Bibliotheksbestellung in der Datei msim_setup.tcl folgen, die im Verzeichnis <IP_variation_name>_sim/Mentor angegeben ist .

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 20 Produkte

    Cyclone® V SX SoC-FPGA
    เอฟพีจีเอ Cyclone® V GT
    เอฟพีจีเอ Stratix® V GX
    เอฟพีจีเอ Stratix® V GT
    เอฟพีจีเอ Cyclone® V GX
    เอฟพีจีเอ Stratix® V GS
    เอฟพีจีเอ Arria® V GZ
    Arria® V SX SoC-FPGA
    Cyclone® V ST SoC-FPGA
    Arria® V ST SoC-FPGA
    เอฟพีจีเอ Arria® V GX
    เอฟพีจีเอ Arria® V GT
    เอฟพีจีเอ Arria® II GZ
    Stratix® III FPGAs
    เอฟพีจีเอ Stratix® IV GX
    เอฟพีจีเอ Stratix® IV GT
    เอฟพีจีเอ Cyclone® V E
    เอฟพีจีเอ Stratix® V E
    เอฟพีจีเอ Stratix® IV E
    Cyclone® V SE SoC-FPGA

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