Artikel-ID: 000077163 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 13.08.2015

Muss ich fftpts_in des FFT-Intel® FPGA IP kerns fahren, selbst wenn ich die Blockgröße nicht ändere?

Umgebung

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

Beim Versuch, Daten über den FFT-Intel® FPGA IP kern zu verarbeiten, können Quellenfehler (fehlendes SOP, fehlendes EOP) angezeigt werden, wenn fftpts_in nicht falsch angetrieben oder betrieben werden.

Lösung

fftpts_in muss angetrieben werden, selbst wenn man die Blockgröße nicht dynamisch ändert. Bei einer Implementierung einer festen Blockgröße sollte sie entsprechend der im Parametereditor ausgewählten Transformationslänge betrieben werden.

Zugehörige Produkte

Dieser Artikel bezieht sich auf 25 Produkte

เอฟพีจีเอ Stratix® V GX
เอฟพีจีเอ Stratix® IV GT
เอฟพีจีเอ Stratix® IV E
เอฟพีจีเอ Stratix® V GS
เอฟพีจีเอ Stratix® V GT
Intel® MAX® 10 FPGAs
เอฟพีจีเอ Stratix® V E
เอฟพีจีเอ Stratix® IV GX
เอฟพีจีเอ Cyclone® V GX
เอฟพีจีเอ Cyclone® V E
เอฟพีจีเอ Cyclone® V GT
Cyclone® V SE SoC-FPGA
Cyclone® V ST SoC-FPGA
เอฟพีจีเอ Cyclone® IV GX
Cyclone® V SX SoC-FPGA
เอฟพีจีเอ Intel® Arria® 10 GX
Intel® Arria® 10 GT SoC-FPGA
เอฟพีจีเอ Arria® II GX
เอฟพีจีเอ Arria® II GZ
เอฟพีจีเอ Arria® V GT
เอฟพีจีเอ Arria® V GX
เอฟพีจีเอ Arria® V GZ
เอฟพีจีเอ Intel® Arria® 10 GT
Arria® V ST SoC-FPGA
Arria® V SX SoC-FPGA

Der Inhalt dieser Seite ist eine Kombination aus menschlicher und computerbasierter Übersetzung des originalen, englischsprachigen Inhalts. Dieser Inhalt wird zum besseren Verständnis und nur zur allgemeinen Information bereitgestellt und sollte nicht als vollständig oder fehlerfrei betrachtet werden. Sollte eine Diskrepanz zwischen der englischsprachigen Version dieser Seite und der Übersetzung auftreten, gilt die englische Version. Englische Version dieser Seite anzeigen.