Artikel-ID: 000075604 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 11.09.2012

Warum wird das Timing meines UniPHY External Memory Interface Toolkits durchgeführt?

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    DDR2- und DDR3-SDRAM-Designs hängen das EMIF-Debugging-Toolkit (External Memory Interfaces), wenn der Kern die VFIFO-Lesekalibrierungsstufe ausfällt. Dies ist ein bekanntes Problem in der Quartus® II Softwareversion 11.1 bis 11.1SP2. Das Debugging-Toolkit wird eventuell mit der folgenden Fehlermeldung angezeigt:

    Die Antwort vom Prozessor konnte nicht innerhalb der zulässigen Zeit zurückerhalten werden!

    Lösung

    Die Problemumgehung besteht darin, die Timeout-Anzahl im Systemkonsolen-Tcl-Skript zu erhöhen. Hier sind die Schritte zur Implementierung der Problemumgehung:

    1) Öffnen Sie die nios_phy_111.tcl-Datei im folgenden Verzeichnis:

    \quartus\sopc_builder\system_console\lib\emdb

    2) Suchen Sie nach der Variable MAX_PROC_LOOP und ändern Sie sie wie unten gezeigt in 4000. Diese Variable gibt die Anzahl der Sekunden an, die das Debug-Toolkit warten wird, um vom Nios Sequencer zurück zu hören, bevor das Timing ausgeht:

          Anzahl der maximalen Anzahl von Zeiten, die wir durch die Schlafschleife gehen können, die auf den Prozessor wartet

          Variable MAX_PROC_LOOP 4000

    3) Öffnen Sie das Debugging-Toolkit erneut und stellen Sie eine Verbindung zum Stratix V-Gerät her. Es kann einige Minuten dauern, bis die Verbindung hergestellt wird, aber es sollte eine Verbindung hergestellt werden und Ihnen mitteilen, welches Kalibrierungsstufe fehlgeschlagen ist.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 8 Produkte

    Stratix® V FPGAs
    เอฟพีจีเอ Stratix® V E
    เอฟพีจีเอ Stratix® V GX
    เอฟพีจีเอ Stratix® V GT
    เอฟพีจีเอ Stratix® V GS
    เอฟพีจีเอ Stratix® IV GX
    เอฟพีจีเอ Stratix® IV GT
    เอฟพีจีเอ Stratix® IV E

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