Artikel-ID: 000074548 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 12.04.2016

Warum schlägt die Simulation für die Hard IP für PCI Express fehl, wenn CVP aktiviert ist?

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • PCI Express*
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Das Simulationsmodell für die Hard IP für PCI Express funktioniert nicht korrekt, wenn CvP innerhalb der Quartus® II Software aktiviert ist. Wenn Sie versuchen, den Simulationstestbench mit aktiviertem CvP auszuführen, schlägt der Testbench fehl.

    Lösung

    Es ist nicht geplant, dieses Problem zu beheben.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 15 Produkte

    เอฟพีจีเอ Stratix® V GS
    เอฟพีจีเอ Arria® V GZ
    เอฟพีจีเอ Cyclone® V GX
    Arria® V SX SoC-FPGA
    Cyclone® V ST SoC-FPGA
    Arria® V ST SoC-FPGA
    เอฟพีจีเอ Arria® V GX
    เอฟพีจีเอ Intel® Arria® 10 GT
    Cyclone® V SX SoC-FPGA
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    เอฟพีจีเอ Stratix® V GX
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    เอฟพีจีเอ Arria® V GT
    เอฟพีจีเอ Intel® Arria® 10 GX
    Intel® Arria® 10 GT SoC-FPGA

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