PCI* Express (PCIE) IP Core Ressourcen-Center
Intel® FPGA bietet umfangreiche Dokumentation und Unterstützung für die PCI Express MegaCore-Funktion, damit Sie PCI Express (PCIe)-Anwendungen schnell und einfach entwickeln und debuggen können.
Literatur
- PCI-Express
- Arria® V GZ Hard IP für PCI Express Benutzerhandbuch
- Arria® V Hard IP für PCI Express Anleitung
- Cyclone® V Hard IP für PCI Express Anleitung
- Stratix® V Hard IP für PCI Express Anleitung
- IP Compiler für PCI Express Benutzerhandbuch (Arria® II GX und GZ, Cyclone® IV GX und Stratix® IV GX)
- Versionshinweise für die MegaCore IP-Bibliothek
- Archiv der Versionshinweise für geistiges Eigentum
- Whitepaper: Kostengünstige FPGA Lösungen für die PCI-Express-Implementierung
Anwendungshinweise
- AN 431: PCI Express-zu-externer Speicher Referenzdesign (Arria® GX und Stratix® II FPGAs)
- AN 443: Externe PHY-Unterstützung in PCI-Express-MegaCore-Funktionen
- AN 456: PCI Express Hochleistungs-Referenzdesign (Stratix IV GX, Stratix II GX und Arria GX FPGAs)
- AN 532: Ein PCI-Express-Design für SOPC-Builder mit GUI-Schnittstelle
Intel FPGA Wissensdatenbank
Die Wissensdatenbank bietet Supportlösungen, Antworten auf häufig gestellte Fragen und Informationen zu bekannten Problemen bezüglich der PCI Express MegaCore-Funktion.
Häufig aufgerufene Lösungen anzeigen:
- Wenn der harte PCI-Express-IP-Block in Stratix IV GX-Geräten aktiviert ist, kann ich dann alle anderen Transceiver-Kanäle in einem Transceiver-Block verwenden?
- Kann ich die PCI Express Hard IP mit einem externen PHY verwenden?
- PCI Express Compiler Benutzerhandbuch Version 9.0: Bekannte Probleme
- Wenn ich die PCI Express (PIPE) x8-Konfiguration in einem Stratix IV GX-Gerät simuliere, warum ist der Coreclkout-Port [1] immer logisch niedrig?
Weitere Lösungen finden Sie mit der PCI Express MegaCore Funktion.
Online-Schulungen (LMS)
Entwicklungskits
Für die PCI-Express-MegaCore-Funktion stehen folgende Entwicklungskits zur Verfügung:
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