PCI* Express (PCIE) IP Core Ressourcencenter
Intel® FPGA bietet umfangreiche Dokumentation und Unterstützung für die PCI Express MegaCore-Funktion, mit der Sie PCI Express (PCIe)-Anwendungen schnell und einfach entwickeln und debuggen können.
Literatur
- PCI-Express
- Arria® V GZ Hard IP für PCI Express Benutzerhandbuch
- Arria® V Hard IP für PCI Express Benutzerhandbuch
- Cyclone® V Hard IP für PCI Express Benutzerhandbuch
- Stratix® V Hard IP für PCI Express – Benutzerhandbuch
- IP-Compiler für PCI Express Benutzerhandbuch (Arria® II GX und GZ, Cyclone® IV GX und Stratix® IV GX)
- Versionshinweise zur MegaCore IP-Bibliothek
- Archiv der Versionshinweise zum geistigen Eigentum
- Whitepaper zu kostengünstigen FPGA-Lösungen für die PCI Express-Implementierung
Anwendungshinweise
- AN 431: PCI Express–to-External Memory Reference Design (Arria® GX und Stratix® II FPGAs)
- AN 443: Externe PHY-Unterstützung in PCI Express MegaCore-Funktionen
- AN 456: PCI Express Hochleistungs-Referenzdesign (Stratix IV GX, Stratix II GX und Arria GX FPGAs)
- AN 532: Ein SOPC Builder PCI Express Design mit GUI Interface
Intel FPGA Wissensdatenbank
Die Knowledge Database bietet Supportlösungen, Antworten auf häufig gestellte Fragen und Informationen zu bekannten Problemen in Bezug auf die PCI Express MegaCore-Funktion.
Häufig aufgerufene Lösungen anzeigen:
- Wenn der PCI Express-Hard-IP-Block in Stratix IV GX-Geräten aktiviert ist, kann ich dann alle anderen Transceiver-Kanäle in einem Transceiver-Block verwenden?
- Kann ich die PCI Express Hard IP mit einem externen PHY verwenden?
- PCI Express Compiler Benutzerhandbuch Version 9.0: Bekannte Probleme
- Wenn ich die PCI Express (PIPE) x8-Konfiguration in einem Stratix IV GX-Gerät simuliere, warum ist der coreclkout [1]-Port immer auf logisch niedrig?
Weitere Lösungen finden Sie in der PCI Express MegaCore-Funktion.
Entwicklungskits
Für die PCI Express MegaCore Funktion stehen folgende Development Kits zur Verfügung:
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