VHDL: Ein-Port-ROM

author-image

Von

Dieses Beispiel beschreibt ein 256-Bit x 8-Bit-Single-Port-ROM-Design mit einem Adressport für Leseoperationen in VHDL. Synthesetools können ROM-Designs im HDL-Code erkennen und je nach Gerätearchitektur automatisch den Altsyncram oder lpm_rom Megafunktionen ableiten.

Abbildung 1. Einzel-Port-ROM-Top-Level-Diagramm

Laden Sie die in diesem Beispiel verwendeten Dateien herunter:

Die Verwendung dieses Designs unterliegt den Bedingungen der Intel® Design Example Lizenzvereinbarung.

Der Inhalt dieser Seite ist eine Kombination aus menschlicher und computerbasierter Übersetzung des originalen, englischsprachigen Inhalts. Dieser Inhalt wird zum besseren Verständnis und nur zur allgemeinen Information bereitgestellt und sollte nicht als vollständig oder fehlerfrei betrachtet werden. Sollte eine Diskrepanz zwischen der englischsprachigen Version dieser Seite und der Übersetzung auftreten, gilt die englische Version. Englische Version dieser Seite anzeigen.