Designbeispiel für FPGA-zu-HPS-Bridges

Empfohlen für:

  • Gerät: Intel® Arria® 10

  • Gerät: Cyclone® V

  • Quartus®: v16.0

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Das Designbeispiel FPGA-zu-HPS-Bridges übt die speicherzubereiteten Schnittstellen des Hard-Processor-Systems (HPS), das der FPGA Fabric ausgesetzt ist, aus. Das Design führt Speichertests durch Schreiben und Lesen des HPS-Speichers unter Verwendung verschiedener Ports des HPS durch und misst die Leistung der Datenbewegungen.

Das Design wird für die folgenden Entwicklungskits bereitgestellt:

Das Design wird mit den folgenden Tools zusammengestellt:

  • Intel® Quartus® Prime Software v16.0
  • Intel® SoC FPGA Embedded Design Suite (EDS) v16.0

Das Design verwendet ein Paar modularer SGDMAs und einen PRBS-Musterchecker (Binary Sequence) und einen Generator, um Daten zwischen dem FPGA Fabric und dem HPS SDRAM-Controller zu übertragen und die Integrität der Daten zu testen. Das Design übt die FPGA-zu-HPS-Bridge aus, um zwischengespeicherte und nicht cacheable Zugriffe auf SDRAM durchzuführen. Das Design übt auch die FPGA-zu-SDRAM-Schnittstellen aus, die es dem FPGA ermöglichen, direkt auf den HPS SDRAM zuzugreifen, ohne Daten über den MPU-Beschleuniger- oder Interconnect-Port (HPS L3 Interconnect) zu weitergeben.

Hardware-Designspezifikationen

  • Arria® 10 HPS
  • 1 GB DDR4-SDRAM
  • DMA-Subsystem (Direct Memory Access)
    • mSGDMA
    • PRBS Pattern Checker (benutzerdefiniertes geistiges Eigentum (IP), bereitgestellt mit diesem Design)
    • PRBS-Mustergenerator (benutzerdefinierte IP mit diesem Design bereitgestellt)

Abbildung 1. Blockdiagramm der obersten Ebene.

Abbildung 2. DMA-Subsystemdiagramm.

Anhand dieses Designbeispiels

Laden Sie das Designbeispiel Arria® 10 FPGA-zu-HPS Bridges herunter (.zip-Datei)

Laden Sie das Designbeispiel Arria 10 FPGA zu HPS Bridges readme herunter (.txt-Datei)

Laden Sie das Designbeispiel Cyclone V FPGA-zu-HPS Bridges herunter (.zip-Datei)

Laden Sie das Designbeispiel Cyclone V FPGA-zu-HPS Bridges herunter readme (.txt-Datei)
Die Verwendung dieses Designs unterliegt den Bedingungen der Hardware-Referenzdesignlizenzvereinbarung.

Die .zip-Datei enthält alle notwendigen Hardware- und Softwaredateien zur Wiedergabe des Beispiels sowie eine readme.txt-Datei. Die Datei readme.txt enthält Anleitungen zur Neukonstruktion des Designs.

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