Intel® FPGA Designbeispiele
Intel® Designbeispiele bieten effiziente Lösungen für gängige Design-Herausforderungen. Diese Designs können als Ausgangspunkt für die Entwicklung mit Ihrem einzigartigen System verwendet werden und stehen mit vielen Funktionen zur Verfügung, wie Filter, arithmetische Funktionen, Fehlererkennung/Korrektur, Modulation/Demodulation sowie Video- und Bildverarbeitung.
Designbeispiele gibt es auch im Design Store für Intel® FPGAs und RocketBoards.org.
4/11/2023
OpenCL-| Intel
Das Beispiel des OpenCL-Fraktal-Algorithmus stellt einen Kernel bereit, der den Fraktalalgorithmus für Dies sowie eine Host-Anwendung implementiert, die die Ergebnisse am Bildschirm anzeigt.
Ziel dieses Beispiels ist es, den Weg zur Einschränkung der TSE_RGMII zu zeigen. Es kann mit 3 verschiedenen Geschwindigkeiten ausgeführt werden, die 10 MHz, 100 MHz und 1000 MHz sind.
In diesem Leitfaden des Intel Support-Teams finden Sie Download-Dateien, Systemvoraussetzungen und Funktionen für das Serial RapidIO bis TI 6482 DSP Referenzdesign.
Das PCI-Express*-Protokoll (PCIe*) ist ein leistungsstarkes, skalierbares und funktionsstarkes serielles Protokoll mit Datenübertragungsraten von 2,5 Gigatransfers pro Sekunde (GT/s) bis 16,0 GT/s.
Das Drive-on-a-Chip-Motorsteuerungs-Referenzdesign von Intel ist ein integriertes Antriebssystem auf einem einzigen Cyclone V SoC oder Intel MAX 10. Weitere Informationen finden Sie in diesem Leitfaden.
Suchen Sie in Intels Inhaltssammlung nach Entwicklungshandbüchern, Schulungen, Software-Downloads und Software-Kits nach FPGA SDK für OpenCL.
Dieses Beispiel beschreibt ein synchrones 64-Bit x 8-Bit-RAM-Design mit true Dual-Port-RAM mit einer beliebigen Kombination unabhängiger Lese- oder Schreibvorgänge im gleichen Taktzyklus in VHDL.
Dieses Beispiel beschreibt ein synchrones 64-Bit x 8-Bit-Dual-Clock-RAM-Design mit verschiedenen Lese- und Schreibadressen in VHDL. Erfahren Sie mehr über das synchrone Design von Intel.
Dieses VHDL-1x64-Shift-Register-Designbeispiel beschreibt ein ein Bit breites, 64-Bit langes Shift-Register in VHDL. Erfahren Sie mehr über dieses Design von Intel.
Dieses Beispiel beschreibt ein 64-Bit x 8-Bit-Ein-Port-RAM-Design mit gängigen Lese- und Schreibadressen in VHDL. Erfahren Sie mehr über dieses Design von Intel.
Dieses Beispiel beschreibt einen 16-Bit-Binär-Adder-Tree in VHDL. Geräte mit 4-Eingabe-Lookup-Tabellen in Logikelementen (LEs) können die Leistung mit einer Binär-Adder-Struktur verbessern.
Der Inhalt dieser Seite ist eine Kombination aus menschlicher und computerbasierter Übersetzung des originalen, englischsprachigen Inhalts. Dieser Inhalt wird zum besseren Verständnis und nur zur allgemeinen Information bereitgestellt und sollte nicht als vollständig oder fehlerfrei betrachtet werden. Sollte eine Diskrepanz zwischen der englischsprachigen Version dieser Seite und der Übersetzung auftreten, gilt die englische Version. Englische Version dieser Seite anzeigen.