JTAG-Konfiguration
Das JTAG-Konfigurationsschema verwendet die IEEE-Standard-1149.1 JTAG-Schnittstellen-Pins und unterstützt den JAM-Standard Test and Programming Language (STELLTPL). Serial Vector File (SVF) wird in Intel® FPGA Geräten mit Programmiertools von Drittanbietern unterstützt. Intel FPGA Geräte sind so konzipiert, dass JTAG-Anweisungen den Vorrang vor jedem Gerätekonfigurationsmodus haben. Daher kann die JTAG-Konfiguration stattfinden, ohne auf den Abschluss anderer Konfigurationsmodi zu warten. Die JTAG-Konfiguration kann mit einem Intel FPGA-Download-Kabel oder einem intelligenten Host, wie einem Mikroprozessor, durchgeführt werden.
Konfigurationsmethode
- Intel® FPGA Kabel herunterladen
- Verwenden eines Downloadkabels, um Konfigurationsdaten herunterzuladen oder Daten während des Prototypings während der Produktion in das System zu programmieren.
- JE
- Tragbarer Softwaretreiber zur Konfiguration eines FPGA über eine JTAG-Schnittstelle.
- Funktioniert auf einem PC oder embedded Prozessoren.
- Es können Byte- Oder Byte-VerteilerMVTM-Downloadkabel verwendet werden.
- Quellcode für die Portierung auf ein Embedded-System oder eine andere Plattform verfügbar.
- Jam-NPL-Player
- Bietet In-System-Programmierung (ISP) über die JTAG-Schnittstelle an.
- Funktioniert auf einem PC oder embedded Prozessoren.
- Byte-Verteiler II oder Byte- Oder Byte- /Byte- 2005-Download-Kabel können verwendet werden.
Dokumentation
- Stratix® IV Gerätehandbuch, Teil 1, Kapitel 12: JTAG Boundary-Scan Testing
- IEEE 1149.1 (JTAG) Boundary-Scan-Tests in Stratix® III Geräten
- IEEE 1149.1 (JTAG) Boundary-Scan-Tests in Stratix® II und Stratix II GX Geräten
- IEEE 1149.1 (JTAG) Boundary-Scan-Tests für Cyclone® III Geräte
- IEEE 1149.1 (JTAG) Boundary-Scan-Tests für Cyclone® II Geräte
- IEEE 1149.1 (JTAG) Boundary-Scan-Tests für Arria GX-Geräte
- JTAG Boundary-Scan-Tests für Arria II Geräte
- AN 39: IEEE 1149.1 (JTAG) Boundary-Scan-Tests in Intel FPGA Geräten
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