Artikel-ID: 000099036 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 14.06.2024

Warum schlägt die Generierung des F-Tile DisplayPort FPGA IP-Designbeispiels mit aktivierter Simulationsoption fehl?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • DisplayPort*
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems in der Quartus® Prime Pro Edition Software v23.4 und früher kann das F-Tile DisplayPort FPGA IP-Designbeispiel mit aktivierter Simulation nicht erfolgreich generiert werden.

    Lösung

    Wählen Sie beim Generieren des F-Tile DisplayPort FPGA IP-Designbeispiels nicht die Simulationsoption aus. Das Designbeispiel kann ohne die Simulationsoption erfolgreich generiert werden.

    Dieses Problem wurde ab Version 24.1 der Quartus® Prime Pro Edition Software behoben.

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    Intel® Agilex™ FPGAs und SoC FPGAs

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