Artikel-ID: 000098888 Inhaltstyp: Errata Letzte Überprüfung: 20.05.2024

Warum stoppt der MAC TX des F-Tile Ethernet FPGA Hard IP die Übertragung von Control Frames (0x8808), wenn er PAUSE-Frames vom Verbindungspartner empfängt?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Gemäß Anhang 31B.1 der Spezifikation IEEE802.3 wird darauf hingewiesen, dass der Pausenvorgang die Übertragung von MAC-Steuer-Frames nicht hemmt. Die aktuelle Implementierung des F-Tile Ethernet FPGA Hard IP-Mechanismus für die Verarbeitung von Ethernet-Frames ist jedoch nicht auf diese Spezifikation abgestimmt, da wir die Übertragung aller Ethernet-Frames unabhängig von ihrem Typ wahllos anhalten.

    Benutzer, die PFC oder SFC-Frames übertragen möchten, können die SFC/PFC-Frame-Generierung innerhalb von HIP verwenden, was durch die Registerkonfiguration erleichtert wird. Es ist wichtig zu beachten, dass unser System zwar diese spezifischen Frames unterstützt, die IEEE-Spezifikation jedoch eine breitere Palette von Steuerungs-Frame-Typen enthält, wie in Anhang 31A beschrieben, die HIP nicht generiert.

    Alternativ können Kunden die F-Tile Ethernet FPGA Hard IP so konfigurieren, dass die Verkehrsübertragung beim Empfang von Pause-Frames nicht angehalten wird. Stattdessen können sie das o_pause Signal nutzen, um Übertragungsentscheidungen auf Benutzerseite zu treffen, insbesondere in Bezug auf die Übertragung von Steuerrahmen.

    Lösung

    Es gibt keine Problemumgehung für dieses Problem.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Agilex™ FPGAs und SoC FPGAs

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