Artikel-ID: 000098763 Inhaltstyp: Fehlermeldungen Letzte Überprüfung: 20.05.2024

Warum schlägt das Low Latency Ethernet 10G MAC Stratix® 10 FPGA IP 10GBASE-R Ethernet Designbeispiel bei der Simulation mit dem Tool Cadence* Xcelium* fehl?

Umgebung

    Intel® Quartus® Prime Pro Edition
    Niedrige Latenz Ethernet 10G MAC Intel® FPGA IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

Aufgrund eines Problems in der Quartus® Prime Pro Edition Software Version 23.3 und früher schlägt das 10GBASE-R Ethernet-Designbeispiel für Low Latency Ethernet 10G MAC Stratix® 10 FPGA IP bei der Simulation mit dem Tool Cadence* Xcelium* fehl.

Lösung

Dieses Problem wurde ab Version 23.4 der Quartus® Prime Pro Edition Software behoben.

Zugehörige Produkte

Dieser Artikel bezieht sich auf 1 Produkte

Intel® Stratix® 10 FPGAs und SoC FPGAs

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