Artikel-ID: 000098230 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 23.04.2024

Warum aktiviert das F-Tile Triple-Speed Ethernet FPGA IP-Designbeispiel die automatische RX-Anpassung?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • 3-Speed-Ethernet Intel® FPGA IP
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems in der Quartus® Prime Pro Edition Software Version 23.4 wird die automatische RX-Anpassung automatisch in dem Designbeispiel aktiviert, das vom F-Tile Triple-Speed Ethernet FPGA generiert wird.

    Gemäß AN 969: F-Tile PMA Tuning Guidelines sind die folgenden Richtlinien für die automatische RX-Anpassung:

    "Für Anwendungen mit niedrigeren Datenraten, die normalerweise unverschlüsselte Daten verwenden, z. B. CPRI 6 Gbit/s und niedriger, DisplayPort weniger als 8 Gbit/s, können Sie die automatische Anpassung deaktivieren. Dies liegt daran, dass DFE bei diesen unverschlüsselten Datenanwendungen möglicherweise eine Herausforderung bei der Konvergenz darstellt und somit Fehler einführt oder zu Leistungseinbußen führt, wenn die automatische Anpassung aktiviert ist."

    Lösung

    Um dieses Problem zu umgehen, ändern Sie die Datei Quartus® Settings File (.qsf) des generierten Designbeispiels, um die automatische RX-Anpassung gemäß dem Abschnitt "FGT PMA Settings" im F-Tile Architecture and PMA and FEC Direct PHY IP Benutzerhandbuch zu umgehen.

    Dieses Problem wurde ab Version 24.1 der Quartus® Prime Pro Edition Software behoben.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Agilex™ FPGAs und SoC FPGAs

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