Um Intel Agilex® 7 FPGA Scheme 2 DDR4 IP im DIMM mit 2 Rängen in Intel® Quartus® Prime Pro Edition Software Version 23.3 zu aktivieren, benötigen wir CK-Taktfrequenzen
"Force Ranks to Shared One Memory Interface Clock" = True
"Alert_N-Pin-Platzierung" = Alert_N in AC2
"Mindestanzahl der AC-Lanes für DDR4" = 3
Dieses Problem wurde ab der Intel® Quartus® Prime Pro Edition Software Version 23.4 behoben