Artikel-ID: 000097176 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 10.05.2024

Warum sind die AXI Interface Ready-Valid-Latenzparameter von Content-Addressable Memory FPGA IP innerhalb des Speichersubsystems FPGA IP deaktiviert?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems in der Quartus® Prime Pro Edition Software Version 23.3 sind die Parameter im Abschnitt AXI Interface Ready-Valid Latency im Content-Addressable Memory FPGA IP deaktiviert.

    Lösung

    Dieses Problem wurde in der Quartus® Prime Pro Edition Software Version 23.4 behoben.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® programmierbare Geräte

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