Artikel-ID: 000095013 Inhaltstyp: Fehlermeldungen Letzte Überprüfung: 23.05.2023

Warum haben die Intel Agilex® 7 DDR4-IP-EMIF-Datenverkehrsgeneratoren mit 2 Leerlaufzyklen und der Schleife im Leerlauf-Zähler ein Missverhältnis?

Umgebung

  • Intel® Quartus® Prime Design Software
  • Externe Speicherschnittstellen Debug-Komponente Intel® FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems in der Intel® Quartus® Prime Pro Edition Software Version 20.4 und früher ist die Anzahl der Leerlaufzyklen zwischen Zwischenschleifen im EMIF-Datenverkehrsgenerator 2.0 (TG2) nicht gleich dem Schleife-Leerlauf-Zähler, wenn die Anzahl der Lese- oder Schreibvorgänge 1 ist. Dieses Problem tritt nur auf, wenn die Anzahl der Schleifen größer als 2 ist, da das Laden des Zählers im Leerlauf der Schleife fälschlicherweise erfolgt ist. Die Anzahl der Leerlaufzyklen zwischen Schleifen ist eine weniger als der Zähler für den Leerlauf der Schleife.

    Lösung

    Dieses Problem wird ab Intel® Quartus® Prime Pro Edition Software Version 21.1 behoben.

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