Artikel-ID: 000092770 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 08.08.2023

"User Mode" (m1_mode_hwtcl) "MCDMA" liegt außerhalb des Bereichs: "Bursting Master", "Bursting Slave", "BAM+BAS"

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • Schnittstellen
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems in der Intel® Quartus® Prime Pro Edition Software Version 22.3 meldet der Multi Channel DMA-Intel® FPGA IP für PCI Express möglicherweise den folgenden Fehler, wenn die IP mit Port-Modus konfiguriert wird: "Root Port":

    "User Mode" (m1_mode_hwtcl) "MCDMA" liegt außerhalb des Bereichs: "Bursting Master", "Bursting Slave", "BAM+BAS"

    Lösung

    Um dieses Problem zu umgehen, führen Sie die folgenden Schritte mit dem IP-Parametereditor aus:

    1. Setzen Sie die Hard IP- und Port-Modi auf Gen4 2x8, Nativer Endpunkt (Top-Level-Einstellungen>Hard IP Mode/Port-Modus).
    2. Setzen Sie den PCIe1 MCDMA-Benutzermodus auf Bursting Master (PCIe1-Einstellungen>PCIe1 MCDMA-Einstellungen>Benutzermodus).
    3. Festgelegt Hard IP-Modus zurück zum von Ihnen benötigten Root-Port-Modus (dh Gen4 x16 / Gen4 x8 Root-Port) (Top-Level-Einstellungen>Hard IP Mode/Port-Modus)

    Wenn Sie den Platform Designer verwenden, um die IP zu instanziieren, können die folgenden zusätzlichen Schritte für eine erfolgreiche Kompilierung erforderlich sein:

    1. Schließen Sie den Platform Designer.
    2. Öffnen Sie den Platform Designer (.qsys) erneut und klicken Sie auf die MCDMA-IP-Komponente.
    3. Klicken Sie auf die Schaltfläche Upgrade unter dem Fenster Parameter der IP.

    Dieses Problem wurde in Intel® Quartus® Prime Pro Edition Software 22.4 behoben.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 2 Produkte

    Intel® Agilex™ FPGAs und SoC FPGAs
    Intel® Stratix® 10 FPGAs und SoC FPGAs

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