Artikel-ID: 000092408 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 09.12.2024

Warum kann Agilex™ 7 SoC FPGA nicht auf den DDR-Speicherplatz zugreifen, wenn HPS EMIF mit Half Rate Converter (HRC) On und Quarter Rate aktiviert ist?

Umgebung

  • Intel® Quartus® Prime Pro Edition

    • u-boot-socfpga

    BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems mit u-boot-spl(u-boot-socfpga-v2022.01) für Agilex™ 7 SoC FPGA können Sie möglicherweise nicht auf den gesamten HPS DDR-Speicherplatz zugreifen, wenn HPS EMIF mit Half Rate Converter (HRC) On and Quarter Rate aktiviert ist. Wenn HPS EMIF beispielsweise eine 2-GB-Konfiguration ist, kann HPS nur auf die erste Hälfte von 2 GB zugreifen, und die zweite Hälfte von 2 GB ist nur ein Alias für die erste Hälfte.

    Lösung

    Um dieses Problem zu umgehen, müssen Sie den Quellcode in u-boot-socfpga/drivers/ddr/altera/sdram_agilex.c(81) von

    update_value |= (hmc_readl(plat, CTRLCFG3) & 0x4);

    An

    update_value |= 0x4;

    Weitere Informationen

    Dieses Problem wurde mit u-boot-spl(u-boot-socfpga-v2023.01) behoben.

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    Intel® Agilex™ FPGAs und SoC FPGAs

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