Artikel-ID: 000092082 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 08.09.2022

Warum meldet Timing Analyzer Negative-Edge-Takte als Positive-Edge-Takte?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems in der Intel® Quartus® Prime Pro Edition Software Version 22.2 und früher können Sie sehen, dass Negative-Edge-Takte vom Timing Analyzer für Register in IO-Zellen als positive Edge-Takte gemeldet werden. Dieses Problem betrifft nur Designs, die auf Intel® Agilex™ Geräte abzielen.

     

     

    Auflösung

    Um dieses Problem zu umgehen, deaktivieren Sie die Registrierungsverpackung bei jeder FF, die einen invertierten Takt in einer IO Cell hat. Zum Beispiel:

     

    set_instance_assignment -name FAST_INPUT_REGISTER -to -entity OFF

    set_instance_assignment -name FAST_OUTPUT_ENABLE_REGISTER -to -entity OFF

    set_instance_assignment -name FAST_OUTPUT_REGISTER -to -entity OFF

     

    Dieses Problem wird voraussichtlich in einer zukünftigen Version der Intel® Quartus® Prime Pro Edition Software behoben.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Agilex™ 7 FPGAs und SoC-FPGAs

    Disclaimer/Rechtliche Hinweise

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