Artikel-ID: 000089968 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 19.10.2023

Warum sehe ich einen "rx_dpa_hold"-Pin, wenn der Modus "RX SOFT-CDR" in Intel® Stratix® 10 FPGA LVDS SERDES IP ausgewählt ist?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • LVDS SERDES Intel® FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems in der Intel® Quartus® Prime Pro Edition Software Version 21.3 und höher können Sie ein Design mit der Intel® Stratix® 10 FPGA LVDS SERDES IP mit dem rx_dpa_hold Pin generieren und kompilieren, wenn der RX SOFT-CDR-Modus ausgewählt ist.

    Lösung

    Sie können den rx_dpa_hold-Pin ignorieren und die Verbindung aufgehoben lassen.

    Dieses Problem soll in einer zukünftigen Version der Intel® Quartus® Prime Pro Edition-Software behoben werden.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Stratix® 10 FPGAs und SoC FPGAs

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