Artikel-ID: 000089642 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 14.03.2023

Warum kann ich das Hard Processor System (HPS) von Intel Agilex 7 FPGA® oder Intel® Stratix® 10 FPGA mit dem Client-Intel® FPGA IP von ")") nicht zurücksetzen?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Möglicherweise sieht man das Hard Processor System (HPS) auf Intel Agilex® 7 SoC FPGA und Intel® Stratix® 10 SoC FPGA bei der Ausgabe des REBOOT_HPS Befehls (0x47) über den Client-Intel® FPGA IP von "Client" nicht zurückgesetzt werden.

    Der REBOOT_HPS Befehl wird vom FPGA Kern zur Secure Device Manager (SDM)-Schnittstelle nicht unterstützt. Der Versuch, das HPS aus dem FPGA Kern zurückzusetzen, ist nicht erfolgreich.

     

     

    Lösung

    Um dieses Problem zu umgehen, müssen Sie den Befehl eingeben, um das HPS über die JTAG-Schnittstelle zurückzusetzen, indem Sie den Systemkonsolen-Paketdienst verwenden, wie in AN 936: Executing SDM Commands via JTAG Interface beschrieben.

    1. Extrahieren Sie den Inhalt der sdm-commands.zip.

    2. Öffnen Sie die Systemkonsole aus der Intel® Quartus® Prime Pro Edition Software, indem Sie auf Tools -> System Debugging Tools -> System Console klicken.

    3. Ändern Sie im Terminalfenster der Systemkonsole die Verzeichnisse, in die die Datei sdm_command.tcl extrahiert wurde.

    4. Geben Sie den folgenden Befehl ein:
      % Quelle sdm_command.tcl

    5. Führen Sie den REBOOT_HPS Befehl (0x47) mit dem exec_command Verfahren aus:
      % exec_command 0x47

    Das Intel Agilex 7 Hard Processor Technical Reference Manual und Intel Stratix 10 Hard Processor System Technical Reference Manual (technisches Referenzhandbuch für Intel Agilex 7 Hard-Prozessoren) werden voraussichtlich mit den oben genannten Informationen aktualisiert.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 2 Produkte

    Intel® Stratix® 10 FPGAs und SoC FPGAs
    Intel® Agilex™ FPGAs und SoC FPGAs

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