Artikel-ID: 000088419 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 06.06.2023

Wie kann ich die Grenzen des Zeilentaktbereichs in der Intel® Quartus® Prime Pro Edition Software anzeigen?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Im Intel® Quartus® Prime Pro Edition Benutzerhandbuch: Teilweise Neukonfiguration heißt es: "Sie können eine Zeilenuhr nicht zwischen zwei PR-Regionen teilen", gibt aber nicht klar an, wie die Zeilentaktbereichsgrenzen in Intel® Quartus® Prime Pro Edition Software-Version angezeigt werden sollen.

    Lösung

    Führen Sie für Intel® Arria® 10 Geräte und Intel® Cyclone® 10 GX-Geräte folgende Schritte durch:

    1. Klicken Tools > Chip-Planer.
    2. Klicken Sie im Chip-Planer auf die Registerkarte Ebenen und wählen Sie die Ebene "Basis".
    3. Überprüfen Sie die Spine-Takt-Region; Sie werden die Spine-Taktbereichsgrenzen sehen.
    4. Ein Zeilen-Taktbereich ist halb-Spine-Uhr breit (geteilt durch die gestrichelte Linie) und eine LAB-Reihe hoch.

    Führen Sie für Intel® Stratix® 10 Geräte und Intel Agilex® Geräte folgende Schritte durch:

    1. Klicken Sie auf Tools > Chip Planner.
    2. Klicken Sie im Chip-Planer auf die Registerkarte Ebenen und wählen Sie die Ebene "Basis".
    3. Prüfen Clock-Sektor-Region; Sehen Sie sich die Grenzen des Taktsektors an.
    4. Eine Zeilenuhren-Region ist halbtaktungsweit (geteilt durch die gestrichelte Linie) und eine LAB-Reihe hoch.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 4 Produkte

    Intel® Agilex™ FPGAs und SoC FPGAs
    Intel® Arria® 10 FPGAs und SoC FPGAs
    เอฟพีจีเอ Intel® Cyclone® 10 GX
    Intel® Stratix® 10 FPGAs und SoC FPGAs

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