Artikel-ID: 000088135 Inhaltstyp: Errata Letzte Überprüfung: 14.02.2023

Warum spiegelt der "o_rx_error"-Port der E-Tile Hard IP for Ethernet Hard Intel® FPGA IP Kern nicht die in der Übertragung enthaltenen Frames wider?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • E-tile Hard IP für Ethernet Intel® FPGA IP

    • OS Independent family

    BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Fehlers in der 100G E-Tile Hard IP für Ethernet Hard Intel® FPGA IP Core RX Statuserkennungslogik können Sie beobachten, dass nicht dargestellte Frames (die standardmäßige maximale Frame-Größe in der IP-Einstellung beträgt 1518) nicht dazu führen, dass das relative Bit des Port-o_rx_error das fehlerhafte Frame-Verhalten widerspiegelt.

     

     

    Lösung

    Es ist nicht geplant, dieses Problem in zukünftiger IP-Version zu beheben. Sie können ein Statistikregister (0x924/0x925) verwenden, um zu überwachen, ob ein Frame bei der Übertragung vorhanden ist.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 2 Produkte

    Intel® Agilex™ FPGAs und SoC FPGAs der F-Reihe
    เอฟพีจีเอ Intel® Stratix® 10 TX

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