Artikel-ID: 000087213 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 15.06.2020

Warum sehe ich Haltezeitverstöße, wenn ich mehr als eine Instanz einer Intel® Stratix® 10 E-Kachel-Geräte-Transceiver-IP verwende?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Möglicherweise sehen Sie Haltezeitverstöße, die durch Uncut-Fehlpfade verursacht werden, wenn mehr als eine Instanz einer Intel Stratix 10 E-tile Geräte-Transceiver-IP verwendet wird.

    Die Haltezeitverstöße umfassen AIB-Register, die von zwei unabhängigen Transceiver-IP-Instanzen getaktet werden. Die IP's sollten falsche Pfade zwischen mehreren Kanälen innerhalb einer IP anwenden, aber Sie müssen False-Path-SDC-Beschränkungen zwischen mehreren Transceiver-IP anwenden.

    Lösung

    Um dieses Problem zu beheben, können Sie set_false_path Einschränkungen in Ihrer SDC-Datei der obersten Ebene anwenden.

    Das unten stehende Beispiel zeigt, wie Sie einen falschen Pfad zwischen zwei Knoten von nicht verwandten Transceiver-IP-Knoten anwenden können

    Pfad ignorieren:

    setzen Sie aib_tx_internal_div_reg_col [get_registers -nowarn nphy_instance_1.xcvr_client_inst|xcvr_native_s10_etile_0|g_xcvr_native_insts[0].ct3_xcvr_native_inst|inst_ct3_xcvr_channel|inst_ct1_hssi_pldadapt_tx~aib_tx_internal_div.reg]

    setzen Sie aib_fabric_transfer_clk_col [get_registers -nowarn nphy_instance_2.xcvr_client_inst|xcvr_native_s10_etile_0|g_xcvr_native_insts[0].ct3_xcvr_native_inst|inst_ct3_xcvr_channel|inst_ct1_hssi_pldadapt_tx~s2_6_0__aibadpt__aib_fabric_tx_transfer_clk.reg]

    Nächster Schritt: False Path (Falscher Pfad) festlegen

    set_false_path vom aib_tx_internal_div_reg_col zum aib_fabric_transfer_clk_col

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Stratix® 10 FPGAs und SoC FPGAs

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