Artikel-ID: 000086977 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 04.11.2013

EMIF-Spezifikations-Update für maximaler Frequenz für Stratix V

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • Simulation
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Kritisches Problem

    Beschreibung

    Dieses Problem betrifft DDR2- und DDR3-Produkte.

    DDR2- und DDR3-Schnittstellen auf Stratix V-Geräten können Schwierigkeiten haben Erreichen des zeitlichen Ablaufs bei bestimmten maximalen Frequenzen.

    Lösung

    Die Problemumgehung für dieses Problem besteht darin, die richtige Anwendung zu treffen. Lösung für Ihre Konfiguration wie unten beschrieben:

    • Für Stratix V, -C1/-C2 Geschwindigkeitsklasse Geräte-Schnittstelle mit einem DDR2-SDRAM-DIMM in einem Quad-Rank-Dual-Slot Konfiguration, mit Soft-Controller mit halber Rate und einer Frequenz Spezifikation von 400 MHz: Upgrade der 400-MHz-DDR2-SDRAM-Komponente auf eine 533-MHz-DDR2-SDRAM-Komponente um die angegebene maximale Frequenz zu erreichen.
    • Für Stratix-V-, -C1/-C2-Geschwindigkeitsklasse-Geräte-Schnittstellen mit einer DDR2 SDRAM-Komponente in einer 2-Chip-Select-Konfiguration, unter Verwendung Soft-Controller mit halber Rate und einer Frequenzspezifikation von 400 Mhz: Upgrade der 400-MHz-DDR2-SDRAM-Komponente auf eine 533-MHz-DDR2-SDRAM-Komponente um die angegebene maximale Frequenz zu erreichen.

    Dieses Problem wird nicht behoben.

    Die Lösungen für die maximalen Frequenzspezifikationen sind: aktualisiert in einer zukünftigen Version der Spezifikationen für externe Speicherschnittstellen Estimator.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 2 Produkte

    Arria® V FPGAs und SoC FPGAs
    Cyclone® V FPGAs und SoC FPGAs

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