Artikel-ID: 000086752 Inhaltstyp: Produktinformationen und Dokumente Letzte Überprüfung: 28.12.2017

Wie kann der Intel Arria-10-EMIF-IP-Beispiel-Design-Datenverkehrsgenerator® für ein festes Datenmuster geändert werden?

Umgebung

  • Intel® Quartus® Prime Design Software
  • Externe Speicherschnittstellen für Intel® Arria® 10 FPGA IP
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Bei der Erzeugung eines Intel® Arria®-10-EMIF-Beispieldesigns wird ein Datenverkehrsgenerator mit einem vordefinierten PRBS-Datenverkehrsmuster implementiert. Für das weitere Debugging kann es nützlich sein, ein festes Datenmuster zu verwenden.

    Lösung

    Das standardmäßige PRBS-Datenmuster wird mit einem LFSR (Linear Feedback Shifting Register) implementiert, das sich in der Datei altera_emif_avl_tg_lfsr_wrapper.sv befindet. Kommentieren Sie den ursprünglichen Code und ändern Sie ihn in das von Ihnen benötigte Datenmuster (siehe Beispiel unten).

    Generieren
    Genvar i;
    für (i = 0; i < NUM_LFSR; i)
    Start: lfsr_gen
    altera_emif_avl_tg_lfsr Anzahl (
    // . BREITE (LFSR_WIDTH),
    // . SEED (SEED* (3 1) i)
    ) lfsr_inst (
    .clk (clk),
    .reset_n (reset_n),
    .enable (aktivieren),
    .data (lfsr_data[(i 1)*LFSR_WIDTH-1):(i*LFSR_WIDTH)])
    // );
    Ende
    endgeneriert

    always_ff @(posedge clk oder negedge reset_n)
    Beginnen
    wenn (!reset_n) beginnen
    lfsr_data <= 256'H00000000FFFFFFFF0000000FFFFFF0000000FFFFFFFF00000000FFFFFF;
    end else, wenn (aktivieren) beginnen
    lfsr_data < = ~lfsr_data;
    Ende
    Ende

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Arria® 10 FPGAs und SoC FPGAs

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