Artikel-ID: 000086640 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 06.11.2018

Warum schlägt Cyclone V Active Serial Konfiguration mit EPCQA-Geräten bei niedrigen Temperaturen fehl?

Umgebung

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

Die aktive serielle Konfiguration Cyclone® V-Geräte kann bei EPCQA-Geräten bei niedrigen Temperaturen (< 20 Grad C und darunter) aufgrund eines Haltezeitproblems ausfallen.


Cyclone die Mindestdaten-Haltezeit(tDH)-Spezifikationen der V AS-Konfiguration wurden wie folgt überarbeitet:

  • 2,5 nm – Für -6 Geschwindigkeitsstufen
  • 2,9 nm – für die Geschwindigkeiten -7 und -8
Lösung
Um dieses Mal null Konfigurationsfehler bei niedrigen Temperaturen zu vermeiden, führen Sie die folgenden Schritte durch:
  1. Berechnen Sie die für das aktive serielle Konfigurationsschema erforderliche Haltezeit, wie im Abschnitt "Evaluation Data Setup and Hold Timing Slack" von AN822 erwähnt, um die "Hold Time Slack" auf dem Mainboard zu bewerten.
  2. Wählen Sie ein Flash-Speichergerät mit einem größeren min tCLQX-Wert gemäß dem Flash-Datenblatt der 3. Partei aus.
    • Sie können beispielsweise 2-nm-tDH-Slack erhalten, indem Sie eines der folgenden Flash-Geräte von Drittanbietern verwenden
    • Winbond™ W25Q-FV
    • Cypress-S25FL-S™/S70FL-S/S25FL1-K
    • Macronix™ MX25L6445E/MX25L6465E/MX25L12845E/MX25L12865E/MX25L25635E
  3. Fügen Sie einen Reihenabschluss-Widerstand/Puffer/Kondensator auf DCLK hinzu und AS_DATA[3:0] Leiterbahnen, um die Verzögerung auf den jeweiligen Signalen zu erhöhen.
    • Eine IBIS/Link-Simulation wird dringend empfohlen, um die zusätzliche Verzögerung abzuleiten, die zur Erfüllung der tDH-Anforderung erwartet wird, um sicherzustellen, dass die Signalintegrität gut ist und sicherzustellen, dass die Eingabe-Timing-Spezifikation des Flash-Geräts erfüllt wird.

Zugehörige Produkte

Dieser Artikel bezieht sich auf 2 Produkte

Cyclone® V FPGAs und SoC FPGAs
Intel® FPGA-Konfigurationsbaustein EPCQ-A

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