Aufgrund eines Problems mit der Intel® MAX® 10 FPGA Modular ADC Intel® FPGA IP VHDL-Simulationseinrichtung werden falsche Modelle generiert.
Diese Fehlermeldung wird ausgegeben, wenn die VHDL-Simulation gestartet wird. Dies tritt auf, weil ein falscher Modulname in automatisch generierten VHDL-Simulationsmodellen verwendet wird.
Verwenden Sie das Verilog HDL-Simulationsmodell, um dieses Problem zu beheben.
Die VHDL-Simulation wird für die Intel MAX 10 FPGA Modular ADC-Intel FPGA IP nicht unterstützt.