Artikel-ID: 000085733 Inhaltstyp: Fehlermeldungen Letzte Überprüfung: 31.08.2015

Warnung (205007): Abgeschnittener Pin-Name in der IBIS-Ausgabedatei auf "IBIS-Pinname", um der IBIS-Norm 3.2/4.0/4.1 zu entsprechen

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Die Versionen 4.1 und früher der IBIS-Spezifikation beschränken die Länge der signal_name Spalte auf 20 Zeichen oder weniger.  Wenn ein FPGA über einen Portnamen der obersten Ebene verfügt, der länger als 20 Zeichen ist, muss die Quartus® II Software den Namen des Ports abkürzen, um der Maximalanzahl von 20 Zeichen gerecht zu werden.

    Lösung

    Für Arria® V-, Stratix® V- und Cyclone® V-Geräte unterstützt die Quartus II Software die Generation von IBIS-Modellen der neueren Versionen 4.2 und 5.0 der IBIS-Spezifikation, die für die signal_name Spalte eine Beschränkung von 40 Zeichen haben.

    Für Stratix V-Geräte kann die IBIS-Version ausgewählt werden, indem Sie im Dialogfeld Einstellungen im Menü Zuweisungen die Kategorie EDA Tool Settings: Board-Level auswählen.

    Für Arria V- und Cyclone V-Geräte muss die Zuweisung manuell zur Datei Quartus Settings (.qsf) hinzugefügt werden.
    Die Zuweisung lautet:

    set_global_assignment -name EDA_IBIS_SPECIFICATION_VERSION -section_id eda_board_design_signal_integrity

    Die Version kann auf 4P2 für Version 4.2-Unterstützung und 5P0 für Version 5.0-Unterstützung eingestellt sein.

     

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 14 Produkte

    เอฟพีจีเอ Arria® V GX
    เอฟพีจีเอ Cyclone® V GT
    เอฟพีจีเอ Arria® V GT
    เอฟพีจีเอ Arria® V GZ
    เอฟพีจีเอ Cyclone® V E
    เอฟพีจีเอ Cyclone® V GX
    Arria® V ST SoC-FPGA
    Cyclone® V SE SoC-FPGA
    Cyclone® V ST SoC-FPGA
    Cyclone® V SX SoC-FPGA
    เอฟพีจีเอ Stratix® V E
    เอฟพีจีเอ Stratix® V GS
    เอฟพีจีเอ Stratix® V GT
    เอฟพีจีเอ Stratix® V GX

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