Kritisches Problem
Die Speichervoreinstellungen enthalten falsche Daten für den und tDHa
den tDSa
Speicher
Timing-Parameter.
Dieses Problem betrifft alle Konfigurationen.
Timing-Analyseergebnisse für Schreib- und Adress-/Befehlspfade kann falsch sein.
Stellen Sie sicher, dass die Speicher-Timing-Parameter im MegaWigabed Der Plug-In-Manager stimmt mit dem Datenblatt des Zielspeichergeräts überein. Die Ausgangsrandrate und die Verwendung von Single-Ended-versus-Differential DQS kann bestimmte Speicherparameter beeinflussen.
Dieses Problem wird in einer zukünftigen Version des DDR2 SDRAM behoben Controller mit ALTMEMPHY IP.