Artikel-ID: 000085343 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 13.05.2014

Warum ist die Anweisung Read Device Dummy Clock unzuverlässig, wenn die QUAD- und DUAL I/O-Optionen im ASMI Parallel Intel® FPGA IP verwendet werden?

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Wenn die read_dummyclk-Eingabe des ASMI Parallel Intel® FPGA IP bestätigt wird, führt die IP einen Lesevorgang des nichtflüchtigen Kontrollregisters des EPCQ-Konfigurationsgeräts durch, um die Anzahl der Dummy-Zyklen zu bestimmen, die für einen schnellen Lesevorgang erforderlich sind.

    Aufgrund eines Problems mit der IP werden die Ausgänge der FPGA während des Lesestatus-Vorgangs zu dem Zeitpunkt, zu dem das EPCQ-Gerät die Daten zurücksende, nicht tri-angegeben.  Dies führt zu einem Konflikt auf die DATA[3..0]-Signale.  Dieser Konflikt kann dazu führen, dass der falsche Wert zurückgegeben wird.

    Lösung

    Verwenden Sie die im ASMI Parallel Intel® FPGA IP verfügbaren DUAL- oder QUAD-I/O-Optionen nicht.

    Dieses Problem wurde ab Version 14.0 der Quartus® II Software behoben.

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