Artikel-ID: 000084892 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 03.12.2012

Warum wird das "pfl_flash_access_request"-Signal in der PFL-Megafunktion (Parallel Flash Loader) nicht zurückgesetzt, wenn ich versuche, ein Stratix V ES-Gerät über ein FPP-Konfigurationsschema (Fast Passive Parallel) zu konfigurieren?

Umgebung

    Intel® Quartus® II Anmeldungs-Edition
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

Wenn Sie ein Stratix® V ES-Gerät mit der PFL über ein FPP-Konfigurationsschema mit den Quartus® II Softwareversionen 12.0 SP1 oder 12.0 SP2 konfigurieren, sehen Sie, dass das "pfl_flash_access_request"-Signal in der PFL-Megafunktion bestätigt wird, wenn der Zugriff auf das Flash-Gerät beginnt, aber nach Abschluss der FPGA Konfiguration niemals de-assertiert wird.

Lösung

Dies ist in der Quartus II Softwareversion 12.1 behoben.

Zugehörige Produkte

Dieser Artikel bezieht sich auf 3 Produkte

Stratix® V FPGAs
MAX® V CPLDs
เอฟพีจีเอ Stratix® V GX

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