Artikel-ID: 000083978 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 31.10.2016

Arria 10 PCI-Express-Benutzerhandbüchern zeigen falsches Timing für die Konfigurationsraumsignale der Transaktionsebene an

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • PCI Express*
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Kritisches Problem

    Beschreibung

    Die Arria-10-Avalon-ST-Schnittstelle für PCIe-Lösungen-Benutzer Leitfaden und Arria der 10-Avalon-MM-Schnittstelle für PCIe-Lösungen Das Benutzerhandbuch zeigt ein falsches Timing-Diagramm für die Transaktionsebene Konfigurationsraumsignale (tl_cfg*). Die Transaktionsebene Configuration Space Interface ist ein Multi-Zyklus-Pfad. Sie müssen diese Schnittstelle zum Beispiel verwenden in der Mitte des 8-Zyklus-Fensters, um einen ordnungsgemäßen Betrieb zu gewährleisten.

    Lösung

    Dieses Problem wurde in den Versionen dieser Benutzer vom 31. Oktober 2016 behoben. Führer.

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