Artikel-ID: 000083582 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 03.12.2012

Im 40 GbE MAC- und PHY-IP-Kern werden kritische Warnungen beim Kompilieren Stratix IV Gerätedesigns generiert

Umgebung

    Intel® Quartus® II Anmeldungs-Edition
BUILT IN - ARTICLE INTRO SECOND COMPONENT

Kritisches Problem

Beschreibung

Einige 40 GbE MAC und PHY IP Core Beispielprojekte kompilieren Stratix-IV-Gerätedesigns für die Version 12.0 des Quartus II Software generiert die folgende kritische Warnung:

Critical Warning: Register-to-register paths between different clock domains is not recommended if one of the clocks is from GXB receiver channel.

Der Fehler wird von den folgenden Projekten generiert:

  • quartus_synth\wrappers\alt_e40_phy\alt_e40_phy_siv.qpf
  • quartus_synth\example_design\alt_e40_adapter_top_siv\alt_e40_adapter_top_siv.qpf
  • quartus_synth\example_design\alt_e40_top_siv\alt_e40_top_siv.qpf

Die kritische Warnung wird durch eine unsachgemäß angegebene Warnung verursacht falscher Pfad in den folgenden .sdc-Dateien :

  • quartus_synth\wrappers\alt_e40_phy\alt_e40_phy_siv.sdc
  • quartus_synth\example_design\common\common_timing.sdc
Lösung

Dieses Problem wurde in der 12.1 Quartus Softwareversion von dem IP-Kern.

Für die Version 12.0 des IP-Kerns ist die kritische Warnung wird durch einen falsch angegebenen falschen Pfad in den folgenden .sdc-Dateien verursacht:

  • quartus_synth\wrappers\alt_e40_phy\alt_e40_phy_siv.sdc
  • quartus_synth\example_design\common\common_timing.sdc

In diesen .sdc-Dateien ist der folgende Codeblock:

if {$::TimeQuestInfo(nameofexecutable) eq "quartus_fit"} { # ok } else { set_false_path -from [get_keepers {*lane_marker_lock*vlane_num[*]} ] }

Sollte durch den folgenden Codeblock ersetzt werden:

set_false_path -from [get_keepers {*lane_marker_lock*vlane_num[*]} ]

Dadurch wird die kritische Warnung verhindert.

Zugehörige Produkte

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Stratix® IV FPGAs

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