Artikel-ID: 000083413 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 11.09.2012

Warum erhalte ich während der Simulation von Byte-Schreibvorgängen in den internen Speicher in der Qsys VHDL-Simulation Hunderte von Warnungen?

Umgebung

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

Bei der Ausführung einer Modelsim VHDL-Simulation eines Qsys-Systems und der Durchführung von 8-Bit- oder 16-Bit-Schreibvorgängen kann die folgende Warnung häufig in der Simulationstoolkonsole angezeigt werden:

Warnung: Es gibt eine "U"-| X'|' W'| Z'| -" in einem arithmetischen Ergebnis "X" (es).

Bei Byte- oder Halfword-Schreibzugriffen ist es sicher, diese Warnung zu ignorieren, da die nicht verwendeten Byte-Lanes der Transaktion verwerfen werden. Um diese Warnungen zu maskieren, kann der folgende Befehl in der Modelsim-Konsole ausgeführt werden, bevor die Simulation gestartet wird:

Einstellen von StdArithNoWarnings 1

Eine Verbesserung der Simulationsmodelle, um diese Verbesserung unnötig zu machen, ist für eine neuere Version des Quartus geplant® II Tool.

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