Artikel-ID: 000083249 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 11.09.2012

Unterstützt QDCONFIG SRAM UniPHY-basierte Schnittstelle oder erfordert sie einrichtungs- und halte-derating für Slew-Rate wie DDR2 SDRAM oder DDR3 SDRAM UniPHY-basierte Controller-IP?

Umgebung

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

Die QDCONFIG SRAM UniPHY-basierte Schnittstelle leitet das Setup und Hold-Derating nicht für Slew-Rate wie DDR2 SDRAM oder DDR3 SDRAM UniPHY-basierte Controller-IP ab. Die Ableitung ist für die QDCONFIG SRAM UniPHY-basierte IP nicht erforderlich.

Zugehörige Produkte

Dieser Artikel bezieht sich auf 8 Produkte

เอฟพีจีเอ Stratix® IV GX
เอฟพีจีเอ Stratix® IV E
เอฟพีจีเอ Stratix® IV GT
Stratix® III FPGAs
เอฟพีจีเอ Stratix® V GT
เอฟพีจีเอ Stratix® V GS
เอฟพีจีเอ Stratix® V E
เอฟพีจีเอ Stratix® V GX

Der Inhalt dieser Seite ist eine Kombination aus menschlicher und computerbasierter Übersetzung des originalen, englischsprachigen Inhalts. Dieser Inhalt wird zum besseren Verständnis und nur zur allgemeinen Information bereitgestellt und sollte nicht als vollständig oder fehlerfrei betrachtet werden. Sollte eine Diskrepanz zwischen der englischsprachigen Version dieser Seite und der Übersetzung auftreten, gilt die englische Version. Englische Version dieser Seite anzeigen.