Wenn Sie die SKP-Erkennungslogik im Gen3-Modus für die Arria® 10 Hard IP for PCI® Express in Quartus® Prime 15.1.2 aktivieren, kann dieser schwerwiegende Fehler angezeigt werden.
Die Zeiteinschränkungsdatei altera_pcie_a10_skp.sdc wird automatisch für die SKP-Erkennungslogik generiert. Wenn diese .sdc-Datei gelesen wird, bevor die PLL-Takte abgeleitet werden, wird dieser Quartus Internal Error angezeigt.
Lesen Sie den Quartus Internal Error, um den Quartus Internal Error zu umgehen altera_pcie_a10_skp.sdc Datei nach den entsprechenden PLL-Takten abgeleitet werden. Sie sollten ausführen derive_pll_clocks zuerst, bevor Sie dies ausführen .sdc Datei. Stellen Sie sicher, dass .sdc Datei mit derive_pll_clocks ist vor dieser Datei aufgeführt.
Dieses Problem wird voraussichtlich in einer zukünftigen Version der Quartus Prime Software behoben werden.