Artikel-ID: 000082954 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 08.02.2018

Warum kann mein Intel® Stratix® 10-PCIe*-Beispieldesign nicht aufzählen?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • Avalon-ST Intel® Stratix® 10 Hard IP für PCI Express*
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund eines Problems mit der Intel® Quartus® Prime Software Version 17.1 fehlen den dynamischen Beispieldesigns, die aus dem Platform Designer oder IP-Katalog generiert werden, einige Pin-Standortzuweisungen. Infolgedessen können diese Designs die Enumeration fehlschlagen, was dazu führt, dass der LTSSM im Detect-Status gehalten wird oder zwischen den Status Detect (Erkennen) und Polling (Abfragung) zykliert wird.
     

    Lösung

    Um dieses Problem zu umgehen, weisen Sie den test_in Signalen virtuellen Pins zu und weisen Sie die Npor-Eingabe einem Stift zu, der standardmäßig einen hohen (true) Zustand hat.

    • Bei der test_in-Zuweisung werden alle diese Signale deasiert, was verhindert, dass die PCIe* IP in einen Testmodus geht.
    • Durch das Verbinden von Npor an einen hohen Input wird verhindert, dass Npor eingefügt wird und die PCIe* IP im Reset gehalten wird.  Auf dem Intel® Stratix® 10 GX Entwicklungskit können Sie Npor mit Pin B20 verbinden, der ein Benutzer-Push-Block mit einem Pullup ist.

    Sie können diese Zuweisungen im Zuweisungseditor vornehmen oder die .qsf-Datei direkt bearbeiten, um diese Zeilen hinzuzufügen:

    set_instance_assignment -name VIRTUAL_PIN ON zu hip_ctrl_test_in -entity pcie_example_design

    set_location_assignment PIN_B20 –zu pcie_rstn_npor

    Dieses Problem wird voraussichtlich in einer zukünftigen Intel® Quartus® Prime Softwareversion behoben werden.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Stratix® 10 FPGAs und SoC FPGAs

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