Artikel-ID: 000081527 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 18.06.2013

Warum kann ich im Parametereditor keinen Wert für "Mixed Port read-During-Write for Single Input Clock RAM" wählen, wenn ich auf den MLAB Speichertyp ausgerichtet bin, wenn entweder die Lese-Adressregister oder Ausgaberegister nicht verwend...

Umgebung

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

MLAB-Speichertypen unterstützen nur einen spezifischen Wert "Mixed Port Read-During-Write for Single Input Clock RAM", wenn sowohl die Leseadressen- als auch die Ausgaberegister verwendet werden.

Wenn eine dieser Registerphasen deaktiviert ist, ist es dem MLAB-Speicher standardmäßig nicht mehr wichtig für Operationen mit gemischten Ports beim Lesen und Schreiben.

Lösung

Nichts

Zugehörige Produkte

Dieser Artikel bezieht sich auf 10 Produkte

เอฟพีจีเอ Stratix® IV E
Stratix® III FPGAs
เอฟพีจีเอ Stratix® IV GT
เอฟพีจีเอ Stratix® IV GX
เอฟพีจีเอ Stratix® V E
เอฟพีจีเอ Stratix® V GS
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เอฟพีจีเอ Arria® II GX
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เอฟพีจีเอ Arria® II GZ

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