Artikel-ID: 000081126 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 03.03.2015

Warum werden im Platform Designer die Dreifachgeschwindigkeits-Ethernet-IP-Core-Taktnamen nicht im Benutzerhandbuch beschrieben?

Umgebung

    Intel® Quartus® II Anmeldungs-Edition
    3-Speed-Ethernet Intel® FPGA IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

Im Benutzerhandbuch für Dreifachgeschwindigkeits-Ethernet werden die Taktnamen beschrieben, die in der Parametereditor-Konfiguration verwendet werden.

 

Der Platform Designer verwendet die folgenden Taktnamen:

 

  • control_port_clock_connection
  • pcs_mac_tx_clock_connection
  • pcs_mac_rx_clock_connection
  • receive_clock_connection
  • transmit_clock_connection
Lösung

Die folgenden Platform Designer-Taktnamen sind äquivalent zu den Taktnamen im Parametereditor:

  • control_port_clock_connection -> CLK
  • pcs_mac_tx_clock_connection – > tx_clk
  • pcs_mac_rx_clock_connection – > rx_clk
  • receive_clock_connection –> ff_rx_clk
  • transmit_clock_connection –> ff_tx_clk

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