Artikel-ID: 000080963 Inhaltstyp: Fehlermeldungen Letzte Überprüfung: 30.10.2017

warnung (19049) der derive_pll_clocks Befehl wird in dieser Produktreihe nicht unterstützt

Umgebung

    Intel® Quartus® Prime Pro Edition
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung

Diese Warnung kann in der Quartus® Software 17.0 und neuer angezeigt werden, wenn Ihr Stratix-10-Projekt derive_pll_clocks SDC-Beschränkung enthält.

Lösung

Um diese Warnung zu vermeiden, können Sie diese Einschränkung aus der SDC-Datei löschen. Das Projekt mit Stratix 10 Gerät kann automatisch Pll-Takte ableiten.

Zugehörige Produkte

Dieser Artikel bezieht sich auf 1 Produkte

Intel® Stratix® 10 FPGAs und SoC FPGAs

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