Artikel-ID: 000080958 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 31.07.2017

Warum sind die Ausgangstakte der Intel® Arria® 10 IOPLL auf die fallende Flanke ausgerichtet und nicht auf die steigende Flanke des Referenztakts?

Umgebung

  • Intel® Quartus® Prime Pro Edition
  • IOPLL Intel® FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Aufgrund des Problems in der Quartus® Prime Software zeigt das IOPLL-Simulationsmodell die Flanke des Ausgangstakts an, die auf die fallende Flanke des Referenztakts ausgerichtet ist, nicht die steigende Flanke des Referenztakts.

    Lösung

    Dies ist nicht das Verhalten, das Sie in Silizium sehen würden. Es handelt sich um einen Fehler im Simulationsmodell, der sich nicht auf die Hardware auswirkt. TimeQuest analysiert das Timing in Bezug auf die steigende Flanke des Referenztakts.

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    Dieser Artikel bezieht sich auf 1 Produkte

    Intel® Arria® 10 FPGAs und SoC FPGAs

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