Artikel-ID: 000080153 Inhaltstyp: Produktinformationen und Dokumente Letzte Überprüfung: 09.03.2015

Wie kann ich den zeitlichen Ablauf bei Verletzungen der Halte- und Einrichtungseinstellungen bei 10 FPGAs Intel® Arria® schließen?

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    In Intel® Arria® 10 Geräten packt der Softwarehersteller Quartus® II Register automatisch in ein Alm (Adaptive Logic Module) ein, um den Bereich zu optimieren. Wenn ein haltekritisches Register in der gleichen ALM wie seine fahrende LUT gepackt wird, fügt der Router Kabel vor der LUT hinzu, um Zeitverstöße zu vermeiden. Dies kann sich negativ auf ein kritisches Pfad-Setup auswirken, das dieselbe LUT durchläuft, was es schwierig macht, sowohl Setup- als auch Zeitverstöße in dieser Struktur zu beheben.

    Lösung

    Eine neue Datei mit den Quartus-Einstellungen (. QSF) Zuweisung ist verfügbar, die das automatische Verpacken des Registers und dessen Einfahren der LUT in das gleiche ALM verhindert. Auf diese Weise kann der Router das notwendige Haltebefestigungskabel direkt vor dem Register hinzufügen und beeinträchtigt die Einrichtung des kritischen Pfads über die LUT selbst nicht negativ.

    Um zu verhindern, dass Register-/LUT-Verpackungen verpackt werden, verwenden Sie die folgende Zuweisung:

    set_instance_assignment -name QII_AUTO_PACKED_REGISTERS AUS -zu <inst_name>

    Diese Zuweisung ist in der Quartus II Softwareversion 14.0 Intel Arria 10 FPGA Edition und neuer verfügbar. Zukünftige Versionen der Quartus II Software sind geplant, um dies automatisch zu bewältigen.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 3 Produkte

    เอฟพีจีเอ Intel® Arria® 10 GT
    เอฟพีจีเอ Intel® Arria® 10 GX
    Intel® Arria® 10 GT SoC-FPGA

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