Artikel-ID: 000080120 Inhaltstyp: Fehlermeldungen Letzte Überprüfung: 29.10.2015

Fehler nofile(37) in geschütztem Bereich

Umgebung

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Beschreibung Der oben beschriebene Fehler kann beim Simulieren eines VHDL-basierten DDR3 UniPHY Speichercontrollerdesigns mit ModelSim auftreten. Wenn der DDR3 Speichercontroller in VHDL generiert wird, werden alle Verilog- und SystemVerilog-Untermodule verschlüsselt, um die Simulation mit einem Einzelsprachen-Simulator zu ermöglichen. Wenn im verschlüsselten Fileset ein Fehler auftritt, wird eine kryptische Nachricht wie die oben beschrieben generiert.
Lösung

Stellen Sie sicher, dass die DDR3-Dateien in der Reihenfolge kompiliert werden, die in der Datei msim_setup.tcl im Verzeichnis _sim angegeben ist. Alle Dateien, die außerhalb der Reihenfolge kompiliert werden, können zu dem oben genannten Fehler führen.

 

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Dieser Artikel bezieht sich auf 27 Produkte

เอฟพีจีเอ Cyclone® V GT
Cyclone® III FPGAs
เอฟพีจีเอ Stratix® V GX
เอฟพีจีเอ Cyclone® IV GX
เอฟพีจีเอ Cyclone® V GX
เอฟพีจีเอ Arria® V GZ
เอฟพีจีเอ Stratix® V GS
เอฟพีจีเอ Stratix® II GX
Stratix® II FPGAs
เอฟพีจีเอ Arria® V GX
เอฟพีจีเอ Stratix® V GT
เอฟพีจีเอ Arria® V GT
Stratix® III FPGAs
เอฟพีจีเอ Stratix® IV GX
เอฟพีจีเอ Arria® II GX
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เอฟพีจีเอ Stratix® IV GT
เอฟพีจีเอ Cyclone® V E
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เอฟพีจีเอ Stratix® V E
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Cyclone® V SE SoC-FPGA
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Arria® V ST SoC-FPGA
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เอฟพีจีเอ Stratix® IV E

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