Artikel-ID: 000079609 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 23.09.2011

falsche Stratix V-Taktnetzwerke

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Kritisches Problem

    Beschreibung

    Die Quartus II Software modelliert das Timing nicht korrekt Leistung von Taktnetzwerken in Stratix V ES-Geräten, wenn beide Die Kanten des Taktsignals werden verwendet. Auswirkungen auf Stratix V Engineering Beispielgeräte.

    Lösung

    Die anwendbare Taktfrequenz finden Sie im Datenblatt Stratix V. Grenzwerte in diesem Fall.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Stratix® V FPGAs

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