Artikel-ID: 000079342 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 16.11.2011

Fehler bei PlL-generierter Taktfrequenz von 67,5 MHz bei Stratix GX-Geräten

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • PLL
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Kritisches Problem

    Beschreibung

    Der Quartus II Schlosser meldet einen Fehler, wenn Sie PLL-generiert verwenden Takteingänge mit 67,5 MHz Taktfrequenz in SDI-SD MegaCore Targeting Stratix GX-Geräte.

    Lösung

    Setzen Sie den Eingangstakt auf 29,7 MHz Taktfrequenz, sodass die PLL generiert die Frequenz des Ausgangstakts auf 74,25 MHz.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 1 Produkte

    Stratix® GX FPGA

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