Artikel-ID: 000078789 Inhaltstyp: Fehlerbehebung Letzte Überprüfung: 11.09.2012

Warum fehlt meinem Qsys UniPHY-basierten Speichercontroller die pin_assignments.tcl-Datei und andere Support-Dateien?

Umgebung

  • Intel® Quartus® II Anmeldungs-Edition
  • DDR3 SDRAM Controller mit UniPHY Intel® FPGA IP
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Beschreibung

    Ein bekanntes Problem besteht bei mehreren Instanziierungen des gleichen UniPHY-basierten Speichercontrollers in einem Qsys-System. Der Qsys-Optimierungsschritt erstellt nur die pin_assignments.tcl-Datei und andere Support-Dateien für den ursprünglichen Controller und verwendet diese Dateien für alle anderen Instanzen des gleichen Controllers.

    Lösung

    Die Problemumgehung besteht darin, eine Änderung an einem nicht kritischen Parameter im UniPHY-Kern vorzunehmen, damit Qsys den Kern als eindeutig erkennt und alle entsprechenden Dateien generiert. Die einfachste Änderung besteht darin, einen der Mainboard-Schiefparameter in der Registerkarte Mainboardeinstellungen um 0,001ps zu ändern. Ändern Sie beispielsweise die "Maximale CK-Verzögerung auf DIMM/Gerät" von 0,6ns auf 0,599ns.

    Sobald Sie alle Instanzen des UniPHY-Controllers einzigartig machen, führen Sie eine Neugenerierung des Qsys-Systems durch, und jede Instanz sollte ihre eigenen Dateien haben.

    Zugehörige Produkte

    Dieser Artikel bezieht sich auf 15 Produkte

    เอฟพีจีเอ Cyclone® V GX
    เอฟพีจีเอ Stratix® V GS
    Arria® V SX SoC-FPGA
    Arria® V ST SoC-FPGA
    เอฟพีจีเอ Arria® V GX
    เอฟพีจีเอ Arria® V GT
    Stratix® III FPGAs
    เอฟพีจีเอ Stratix® IV GX
    เอฟพีจีเอ Stratix® IV GT
    เอฟพีจีเอ Cyclone® V E
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