Das PCI-Express-Spezifikationsrevision® 3.0 beschreibt einen Hot-Reset und wie er über den Link signalisiert wird.
Setzen Sie im Altera® Root-Port Bit[6] Sekundärer Bus-Reset des Bridge-Control-Register (0x03E) einen Hot-Reset verursacht. Lesen Sie Abschnitt 7.5.3.6 der PCIe-Spezifikation Revision 3.0.
Dies ist ein Typ-1-Konfigurationsraumregister, auf das durch Ausgabe eines Typ-0-Konfigurations-TLP zugegriffen wird.